ASIC Design and Synthesis: RTL Design Using VerilogКНИГИ » АППАРАТУРА
Название: ASIC Design and Synthesis: RTL Design Using Verilog Автор: Vaibbhav Taraate Издательство: Springer Год: 2021 Формат: True PDF Страниц: 337 Размер: 11 Mb Язык: English
This book describes simple to complex ASIC design practical scenarios using Verilog. It builds a story from the basic fundamentals of ASIC designs to advanced RTL design concepts using Verilog. Looking at current trends of miniaturization, the contents provide practical information on the issues in ASIC design and synthesis using Synopsys DC and their solution. The book explains how to write efficient RTL using Verilog and how to improve design performance. It also covers architecture design strategies, multiple clock domain designs, low-power design techniques, DFT, pre-layout STA and the overall ASIC design flow with case studies. The contents of this book will be useful to practicing hardware engineers, students, and hobbyists looking to learn about ASIC design and synthesis.
Уважаемый посетитель, Вы зашли на сайт как незарегистрированный пользователь.
С этой публикацией часто скачивают:
HDL with digital design. VHDL and Verilog Название: HDL with digital design. VHDL and Verilog Автор: Botros Издательство: Mercury Learning & Information Год: 2015 Формат: pdf Страниц: 564...
Fundamentals of Digital Logic with Verilog Design Название: Fundamentals of Digital Logic with Verilog Design Автор: Stephen Brown Издательство: McGraw-Hill Год: 2014 Формат: pdf, djvu Страниц: 847...
Digital Systems Design Using Verilog Название: Digital Systems Design Using Verilog Автор: Charles Roth and Byeong Kil Lee Издательство: CL Engineering Год: 2015 Формат: PDF Размер: 11...
Информация
Посетители, находящиеся в группе Гости, не могут оставлять комментарии к данной публикации.
Навигация
Вход на сайт
Реклама
ASIC Design and Synthesis: RTL Design Using Verilog 
